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基于FPGA的嵌入式系統設計:Altera SoC FPGA(基于TERASIC友晶DE1-SOC開發板)

參考價面議
具體成交價以合同協議為準
  • 公司名稱湖北鑫合欣科技有限公司
  • 品       牌
  • 型       號
  • 所  在  地
  • 廠商性質其他
  • 更新時間2022/10/30 15:08:50
  • 訪問次數213
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      湖北鑫合欣科技有限公司是一家專業從事國內外電子測試與測量儀器儀表、電子實訓工藝、教學實驗系統的代理銷售的高科技企業,成立于2010年。專注于實驗室整體解決方案,是中國電子儀器行業協會會員。長期以來,一直與全國各高校及企事業單位保持著密切聯系,并在與高校的合作過程中成為行業內具有品牌影響力的公司。

     湖北鑫合欣科技有限公司隸屬于東湖*開發區,擁有一批來自全國各學府電子及計算機等專業的技術工程師,為產品售前、售中、售后提供強有力保障,是湖北省政府教育裝備招標采購的重點單位。
      公司自成立以來,堅持“一,誠信為本,用戶至上”這一經營理念,積極進取,勇于開拓,在向用戶提供優質產品的同時,以良好的售后服務贏得了廣大用戶的信賴。現擁有著一批來自品牌的核心合作伙伴,如:如:Intel  FPGA、友晶科技、泰克科技、吉時利、蘇州普源、法國CA、美國NI、新大陸、廣州創龍、艾德克斯等。作為高等院校及各企事業單位和生產廠家的橋梁和紐帶,我們將堅持“專業、專注、高質、高效”的經營模式,向湖北省及全國各地的各級用戶提供質優價廉的科研、教學儀器設備。

 

 

內容簡介 《基于FPGA的嵌入式系統設計:AlteraSoCFPGA(第二版)》全面介紹基于AlteraNiosII軟核和ARMCortexA9硬核的嵌入式系統軟硬件設計開發技術
基于FPGA的嵌入式系統設計:Altera SoC FPGA(基于TERASIC友晶DE1-SOC開發板) 產品信息

內容簡介 
《基于FPGA的嵌入式系統設計:Altera SoC FPGA(第二版)》全面介紹基于Altera Nios II軟核和ARM Cortex—A9硬核的嵌入式系統軟硬件設計開發技術,共分為九章,主要內容包括:基于SoC FPGA的嵌入式系統設計概述,Altera SoC FPGA系列器件簡介,Quartus II EDA開發工具應用,Qsys系統開發工具,Nios II EDS嵌入式處理器設計,基于Qsys的HPS模型設計,基于SoC EDS的嵌入式系統設計,基于ARM SoC FPGA的DSP設計,OpenCL入門與應用。《基于FPGA的嵌入式系統設計:Altera SoC FPGA(第二版)》內容豐富,取材新穎,可以作為高等院校電子類和通信類各專業本科生、研究生EDA課程的教材,也可以作為相關專業工程技術人員的參考書。

目錄
第1章 基于SoCFPGA的嵌入式系統設計概述
1.1 SoC嵌入式設計的挑戰與機遇
1.2 Altera提供的解決方案匯集
1.2.1 器件系列
1.2.2 設計軟件工具及嵌入式處理器
1.2.3 可以使用的IP功能
1.2.4 SoCFPGA開發套件簡介

第2章 AlteraSoCFPGA系列器件簡介
2.1 SoCFPGA簡介
2.2 CycloneV器件
2.3 ArriaV器件

第3章 QuartusIIEDA開發工具應用
3.1 現代數字系統設計方法簡介
3.1.1 圖形用戶界面設計方法
3.1.2 EDA數字系統設計流程
3.1.3 QuartusII13.0EDA軟件特點
3.2 QuartusIl13.0軟件安裝
3.3 QuartusIIEDA軟件設計過程
3.4 QuartusIl設計輸入
3.4.1 創建新工程
3.4.2 建立原理圖編輯文件
3.4.3 建立文本編輯文件
3.4.4 建立存儲器編輯文件
3.4.5 設計實例
3.5 設計項目的編譯
3.5.1 項目綜合
3.5.2 QuartusII編譯器選項設置
3.5.3 引腳分配
3.5.4 項目編譯結果分析
3.6 設計項目的仿真驗證
3.6.1 Modelsim軟件架構
3.6.2 Modelsim軟件應用
3.7 TimeQuest時序分析
3.7.1 時序分析基本參數
3.7.2 時序分析基本步驟
3.7.3 查看時序分析報告
3.8 器件編程

第4章 Qsys系統開發工具
4.1 Qsys簡介
4.1.1 SoPC技術簡介
4.1.2 Qsys與SoPC開發
4.1.3 Qsys的功能特點
4.1.4 Qsys的優點
4.2 Qsys設計流程
4.3 Qsys用戶界面
4.3.1 系統元件頁
4.3.2 系統從屬頁
4.3.3 系統選項頁
4.3.4 Qsys菜單命令
4.4 Qsys用戶自定制元件
4.4.1 Qsys組件構成
4.4.2 Qsys組件編輯器
4.4.3 自定義組件實例1——DDS信號產生模塊
4.4.4 自定義組件實例2——以太網控制器W5300控制

第5章 Nios II EDS嵌入式處理器設計
5.1 Nios II嵌入式處理器簡介
5.1.1 **代Nios嵌入式處理器
5.1.2 第二代Nios嵌入式處理器
5.1.3 可配置的軟核嵌入式處理器的優勢
5.2 Nios II嵌入式處理器軟硬件開發流程簡介
5.2.1 硬件開發流程
5.2.2 軟件設計流程
5.2.3 軟件設計實例
5.3 HAL系統庫
5.3.1 HAL系統庫簡介
5.3.2 使用HAL開發程序
5.4 Nios II EDS開發實例
5.4.1 系統軟硬件需求分析
5.4.2 系統硬件設計
5.4.3 系統軟件設計

第6章 基于Qsys的HPS模型設計
6.1 Cyclone V SoC和mlTia V SoC子系統介紹
6.1.1 SoC的CPU部分簡介
6.1.2 SoC的DSP部分(NEON和FPU)簡介
6.2 嵌入式SoC FPGA軟硬件開發流程
6.2.1 建立HPS硬件系統模型
6.2.2 生成Preloader鏡像文件
6.2.3 生成設備樹(Device Tree)
6.2.4 設備樹DTB(Device Tree Blob)檢查

第7章 基于SoC EDS的嵌入式系統設計
7.1 SoC EDS簡介
7.1.1 SoC EDS嵌入式系統設計套件
7.1.2 SoC EDS安裝
7.2 DS-5設計輸入
7.2.1 創建C/C++工程
7.2.2 創建Makefile項目
7.2.3 導入工程
7.2.4 創建源文件
7.3 設計項目的編譯
7.3.1 ARM編譯器和GNU編譯器簡介
7.3.2 DS-5編譯器及其選項設置
7.4 設計項目的調試
7.4.1 調試配置(Debug Configuration)
7.4.2 調試視圖(Debug Views)
7.5 基于ARM編譯器的裸機實例
7.5.1 創建ARMCC項目
7.5.2 建立項目文件
7.5.3 項目編譯
5.4.設計項目的調試
7.6 基于GNU編譯器的裸機實例
7.6.1 創建GNu項目
7.6.2 創建項目文件
7.6.3 跟蹤調試
7.7 ARM Streamline硬件性能分析器
7.7.1 ARM Streamline的基本特點
7.7.2 設置ARM Linux目標機
7.7.3 設置捕捉選項和配置計數器
7.7.4 Live視圖
7.7.5 Timeline視圖
7.7.6 Streamline的其他視圖

第8章 基于ARM SoC FPGA的DSP設計
8.1 NEON和通用DSP的性能對比
8.2 Bare-metal下對NEON和FPU的支持及優化
8.3 NEON的語法特征
8.4 DSP開發實例
8.4.1 基本的DSP處理模塊
8.4.2 浮點向量運算
8.4.3 矩陣運算
8.4.4 FFT算法實現
8.4.5 FIR算法實現
8.4.6 IIR算法實現

第9章 OpenCL入門與應用
9.1 OpenCL簡介
9.2 構建OpenCL環境
9.3 基于OpenCL的實例編譯測試
9.4 OpenCL參考資料說明

關鍵詞:嵌入式系統
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